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Altera_QuartusII_13.0_Windows_Crack.rar是今天闪电吧带来的QuartusII是Altera公司(sī)的综合性(xìng)PLD/FPGA开发软(ruǎn)件,原理(lǐ)图、VHDL、VerilogHDL以(yǐ)及AHDL(Altera Hardware 支持Description Language)等多种设计输入形式,内(nèi)嵌(qiàn)自有的综合器(qì)以及(jí)仿真器,可以完成从(cóng)设计输入到硬件配(pèi)置的完整PLD设(shè)计流程(chéng)。Quartus II支持Altera的IP核,包含了LPM/MegaFunction宏功(gōng)能模(mó)块库,使(shǐ)用户(hù)可(kě)以充分(fèn)利用成熟的模块,简化了设计(jì)的(de)复杂性、加快了设计速(sù)度(dù)。对第三方EDA工具的良好支持也(yě)使用户可以在(zài)设计流程的各个阶段使用熟悉的第三(sān)方EDA工(gōng)具(jù)。
Quartus II提供了完(wán)全集成且与电(diàn)路结(jié)构无关的开(kāi)发包环境(jìng),具有数(shù)字逻辑设计(jì)的全部特(tè)性,包括:
可利用(yòng)原理图、结(jié)构框图、VerilogHDL、AHDL和VHDL完(wán)成电路描(miáo)述,并将其保存为设(shè)计实(shí)体文(wén)件;
芯片(电路)平面布局连线(xiàn)编辑;
LogicLock增量设计(jì)方(fāng)法,用户可建立(lì)并优化系(xì)统,然后添加对原始(shǐ)系统的性能影响较小或无影响的后续(xù)模块;
功能强大的逻辑综合(hé)工具(jù);
完备的电路功能仿真与时序逻辑(jí)仿真工具;
定时/时(shí)序分析与(yǔ)关键路径延时分析(xī);
可使用SignalTap II逻辑分析工具进(jìn)行嵌入(rù)式的逻辑分析;
支持软件源文件的添加和创建,并将它(tā)们链接起(qǐ)来生成编程文件;
使用组合编译方式可一次完成(chéng)整体设计流程;
自动定(dìng)位编译错误;
高效的期间(jiān)编程与(yǔ)验证(zhèng)工具;
可读入(rù)标准的EDIF网(wǎng)表文件、VHDL网(wǎng)表文件和Verilog网表文件;
能生成第三方EDA软(ruǎn)件使用的VHDL网(wǎng)表文件和Verilog网表文(wén)件。
Altera_QuartusII_13.0_Windows_Crack.rar是一款专业实用的(de)PLD/FPGA开发(fā)软件,支持原理图、VHDL、VerilogHDL以及AHDL等多种设(shè)计文件的输入,可(kě)轻(qīng)松完成从设计输入到硬(yìng)件配置(zhì)的整(zhěng)个PLD设(shè)计(jì)流程。Quartus II具有运行速度快,界面统一(yī),功能集中(zhōng),易学易用等特点,完(wán)美支(zhī)持(chí)XP、Linux以及Unix等系统,其强大(dà)的设计(jì)能(néng)力(lì)和直观易用的接(jiē)口,受到越(yuè)来(lái)越多的数字系统设计者欢迎。
